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Test digitaler Schaltkreise

AutorGörschwin Fey, Ilia Polian, Stephan Eggersglüß
VerlagDe Gruyter Oldenbourg
Erscheinungsjahr2014
Seitenanzahl238 Seiten
ISBN9783486720143
FormatePUB/PDF
KopierschutzWasserzeichen/DRM
GerätePC/MAC/eReader/Tablet
Preis84,95 EUR

Embedded systems are assuming key control functions in everyday life. Systemic failure in the energy supply or the transport sector could lead to fatal consequences. Users place great reliance on the error-free function of such systems. Guaranteeing the functional capability of digital circuits is the goal of testing – and this aim must be achieved at low cost, since every chip has to be tested separately after production.



Stephan Eggersglüß, Görschwin Fey, Ilia Polian

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Blick ins Buch
Inhaltsverzeichnis
1 Einleitung11
1.1 Test im Entwurfsablauf12
1.2 Ziele13
1.3 Allgemeiner Ablauf und Anforderungen14
1.4 Wichtige Konferenzen und wissenschaftliche Zeitschriften19
1.5 Aufbau des Buches20
2 Grundlagen23
2.1 Boolesche Gatter23
2.2 Schaltkreise26
2.3 Zeitverhalten28
3 Klassische Fehlermodelle31
3.1 Haftfehler33
3.2 Pfadverzögerungsfehler35
3.3 Transitionsfehler39
3.4 Mehrfach-Entdeckung41
3.5 Fehlerlistenreduktion41
3.5.1 Fehleräquivalenz42
3.5.2 Fehlerdominanz43
3.6 Einordnung und weitere Themen44
4 Fehlersimulation45
4.1 Basisverfahren zur Fehlersimulation46
4.1.1 Simulation eines einzelnen Testmusters47
4.1.2 Ereignisgesteuerte Simulation einer Testmenge49
4.1.3 Simulation einer Testmenge mit Fault Dropping50
4.2 Parallele Fehlersimulation52
4.2.1 Musterparallele Fehlersimulation53
4.2.2 Fehlerparallele Simulation55
4.2.3 Erweiterungen der parallelen Fehlersimulation57
4.3 Deduktive Fehlersimulation59
4.4 Einordnung und weitere Themen60
5 Deterministische Testmustergenerierung63
5.1 Boolesche Differenz64
5.2 D-Algorithmus66
5.2.1 Fünfwertige Logik L567
5.2.2 Implikationen68
5.2.3 Testmustergenerierung für verzweigungsfreie Schaltungen70
5.2.4 Testmustergenerierung für rekonvergente Schaltungen73
5.3 PODEM – Path-Oriented Decision Making79
5.4 FAN – Fanout-Oriented Test Generation85
5.4.1 Unique Sensitization87
5.4.2 Multiple Backtracing88
5.5 Lernverfahren91
5.5.1 Statische Verfahren91
5.5.2 Dynamische Verfahren93
5.6 Boolesche Erfüllbarkeit95
5.6.1 Schaltkreis-zu-KNF-Transformation97
5.6.2 Testmustergenerierung mit Boolescher Erfüllbarkeit99
5.7 Kompaktierung103
5.7.1 Statische Kompaktierung103
5.7.2 Dynamische Kompaktierung107
5.8 Einordnung und weitere Themen109
6 Sequentielle Testmustergenerierung111
6.1 Grundlegende Modellierung112
6.2 Algorithmen115
6.2.1 Strukturelle Verfahren116
6.2.2 Modellierung mittels Boolescher Erfüllbarkeit118
6.2.3 Einsatz von Interpolation120
6.3 Klassen von Schaltkreisen124
6.3.1 Rückkopplungsfreie Schaltkreise124
6.3.2 Mehrere Taktsignale125
6.4 Einordnung und weitere Themen127
7 Design-for-Test (DFT)129
7.1 DFT für kombinatorische Schaltungen130
7.2 DFT für sequentielle Schaltungen132
7.3 Interne Prüfpfade135
7.4 Reduktion der Testanwendungszeit139
7.5 Partielle Prüfpfade140
7.6 Scan-basierter Test für Verzögerungsfehler141
7.7 Boundary Scan144
7.8 Einordnung und weitere Themen145
8 Selbsttest und Testdatenkompression147
8.1 Eingebauter Selbsttest147
8.1.1 Pseudozufällige Testerzeugung mit LFSRs150
8.1.2 Gewichtete Zufallsmuster154
8.2 Ausgangskompaktierung157
8.3 Testdatenkompression162
8.3.1 Illinois Scan164
8.3.2 LFSR Reseeding165
8.3.3 Embedded Deterministic Test167
8.4 Einordnung und weitere Themen170
9 Diagnose173
9.1 Scan-Chain-Diagnose175
9.1.1 Test der Prüfpfade176
9.1.2 Berechnung oberer und unterer Schranken177
9.1.3 Vergleichende Bewertung von Fehlerkandidaten179
9.2 Logikdiagnose180
9.2.1 Antwortabgleich für Haftfehler181
9.2.2 Syndrom-Rückverfolgung für Haftfehler185
9.2.3 Diagnose komplexer Fehler188
9.2.4 Diagnostische Testmustergenerierung190
9.2.5 Einordnung und weitere Themen192
10 Speichertest195
10.1 Fehlermodelle für Speichertest195
10.1.1 Allgemeine Beschreibung von Fehlern im Speicher196
10.1.2 Fehler, die eine Speicherzelle betreffen196
10.1.3 Fehler, die mehrere Speicherzellen betreffen198
10.2 Speichertestmethoden199
10.2.1 Frühe Speichertestmethoden199
10.2.2 March-Tests200
10.3 Selbsttest und Selbstreparatur204
10.4 Einordnung und weitere Themen206
11 Aktuelle Themen207
11.1 Moderne Fehlermodelle207
11.1.1 Mehrfache Entdeckung und erschöpfende Testmuster207
11.1.2 Defektbasierter Test208
11.1.3 Kleine Verzögerungsfehler und Parametervariationen209
11.1.4 Allgemeine Fehlermodellierung210
11.2 Energieverbrauch in der Testanwendung211
11.3 Test 3D-integrierter Schaltungen212
11.4 Einordnung und weitere Themen214
A Symboltabelle217
Literaturverzeichnis219
Index235

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